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机译:考虑VLsI电路漏电流过渡依赖性的静态功率分析与优化
Afshin Abdollahi; Farzan Fallah; Massoud Pedram;
机译:使用自调节电压电平电路的纳米级静态CMOS VLSI乘法器电路的待机泄漏功率降低
机译:基于通道晶体管的上拉/下拉插入技术,用于CMOS VLSI电路中的泄漏功率优化
机译:用于纳米级VLSI系统的漏电优化顺序电路
机译:考虑VLSI电路漏电流过渡相关性的静态功率分析与优化
机译:VLSI电路时序和功率的统计分析和优化。
机译:用于梯度流声源分离的微功率混合信号VLSI独立分量分析
机译:用于纳米级VLsI系统的漏电功率优化时序电路
机译:补偿静电感应晶闸管,使用相同的脉冲电源和高压脉冲电源的漏电流的方法和电路
机译:利用签核质量时序分析信息中的边沿过渡时间来减少电子电路中的泄漏功率的系统和方法,以及采用该系统和方法的电子设计自动化工具
机译:从签核质量时序分析信息中利用边过渡时间来减少电子电路中的泄漏功率的系统和方法,以及包含该特征的电子设计自动化工具
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